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牛芯半導體 ic設計招聘（工資待遇要求）

牛芯半導體 ic設計薪酬區間: 30K - 50K，其中100%的崗位拿￥30-50K

￥30-50K

100%的崗位拿

說明：崗位平均工資是以企業發布的招聘崗位為分析依據，建議結合職位類型及學歷地區經驗等查看。

牛芯半導體 ic設計歷年工資變化

說明：數據取決于當年在線職位薪酬樣本，并不能完全代表企業內部真實情況。僅供參考。

招聘學歷要求：碩士最多

100% 碩士

牛芯半導體 ic設計需要什么學歷？碩士占比最多，占100%

按學歷統計

碩士￥40.0K

牛芯半導體 ic設計工資按學歷統計，碩士工資￥40.0K。

招聘經驗要求：3-5年最多

100% 3-5年

牛芯半導體 ic設計需要什么經驗？ 3-5年占比最多，占100%

按經驗統計

3-5年￥40.0K

牛芯半導體 ic設計工資按經驗統計，3-5年工資￥40.0K。

牛芯半導體 ic設計招聘地區：主要分布在北京，上海

北京￥40.0K 33.3%(1) 򀀩

牛芯半導體 ic設計在哪些城市有辦公地點？主要分布如下：北京占33.3%，想知道其他城市分別占比多少？請點擊該模塊查看，統計依賴近一年招聘職位，僅供參考。

牛芯半導體 ic設計歷年需求趨勢

牛芯半導體 ic設計歷年招聘量變化

牛芯半導體 ic設計是做什么的

取自牛芯半導體近一年相關招聘職位

集成電路IC設計（pcs和ucie方向）
上海-浦東新區 | 3-5年 | 碩士以上 | 2026-01-20
30000-50000

崗位職責：
1、芯片的架構設計、邏輯設計、代碼編寫/仿真；
2、Analog Verilog model建模及仿真；
3、FPGA測試，模塊及系統驗證；
4、模塊綜合，時序分析；
5、IP及芯片驗證。
任職要求：
1、微電子或相關電子專業碩士及以上學歷，5年及以上數字IC設計相關工作經驗，熟悉Verilog/SystemVerilog；
2、熟悉RTL編程、EDA仿真、FPGA測試驗證；
3、能獨立解決問題，有良好的文檔習慣，有較好的溝通能力及團隊精神；
4、具有以下一項或多項設計經驗優先考慮，包括PCIE、RapidIO、USB、JESD204、DDR/LPDDR等
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薪酬區間: 4.5-50K，其中 50.9% 的崗位拿￥10-30K/月

4.5% 4.5-6K 13% 6-8K 15.4% 8-10K 20.7% 10-15K 13.4% 15-20K 16.8% 20-30K 13.3% 30-50K

說明：深圳IT服務行業一個月多少錢？數據統計依賴于各平臺發布的公開薪酬，僅供參考。

高學歷人才需求分析 & 招聘崗位分析

本科 49.2%
碩士 2.6%
博士 0.2%
計算機/網絡/技術類 10.1%
銷售類 8.3%

地區分布集中在哪：南山區

南山區 36.6%
福田區 23.3%
寶安區 12.5%

深圳 ic設計招聘工資待遇

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工資占比最多

較去年變化

深圳 ic設計工資多少？拿30-50K工資占比最多

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